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Johannes Pfau, M. Sc.

Johannes Pfau, M. Sc.

Research Associate
group: Prof. Becker
room: 218.1
CS 30.10

phone: +49 721 608-41939
fax: +49 721 608-42511
johannes pfauPsd5∂kit edu

Engesserstr. 5

76131 Karlsruhe



M. Sc. Johannes Pfau

  • Studium der Elektro- und Informationstechnik am KIT (2012 – 2017)
  • Wissenschaftlicher Mitarbeiter am ITIV seit Oktober 2017

 

Lehre

  • Betreuung des Praktikum System-on-Chip (seit 2017)
  • Studienberater für die Vertiefungsrichtungen 13 und 21 (seit 2019)

 

Forschungsaktivitäten

  • FPGA Architekturen auf Basis neuartiger Transistoren oder Speichertechnologien
  • Tools und Algorithmen zur Synthese von HDL Quellcode für FPGAs

 

Studentische Arbeiten

Bachelor- und Masterarbeiten sowie HiWi-Tätigkeiten zu den Forschungsaktivitäten sind gerne möglich. Neben den ausgeschriebenen Arbeiten sind je nach persönlichem Interesse auch weitere Themen im Bereich der Entwicklung von FPGA Architekturen (primär Hardware, in VHDL) oder der Algorithmen und Tools zur Synthese von HDL Quellcode  möglich. Weitere Informationen zu diesen Themengebieten finden sich in der unten folgenden allgemeinen Ausschreibung. Die weiteren Ausschreibungen sind als Themenvorschläge, die noch individuell angepasst werden können, zu verstehen.

Studentische Arbeiten
Titel Datum
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Publikationen


2018
Proceedingsbeiträge
Reconfigurable FPGA-Based Channelization Using Polyphase Filter Banks for Quantum Computing Systems.
Pfau, J.; Figuli, S. P. D.; Bähr, S.; Becker, J.
2018. Applied Reconfigurable Computing - Architectures, Tools, and Applications, Proceedings of the 14th International Symposium, ARC 2018, Santorini, Greece, 2nd - 4th May 2018. Ed.: Nikolaos Voros, 615–626, Springer, Cham. doi:10.1007/978-3-319-78890-6_49
2016
Zeitschriftenaufsätze
Development of a Latency Optimized Communication Device for WAVE and SAE Based V2X-Applications.
Pistorius, F.; Lauber, A.; Pfau, J.; Klimm, A.; Becker, J.
2016. SAE technical papers, 2016-April, 1–11. doi:10.4271/2016-01-0150