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Becker

Prof. Dr.-Ing. Dr. h. c. Jürgen Becker

Institutsleiter (Sprecher)
Raum: 324
Tel.: +49 721 608-42502
Fax: +49 721 608-42925
beckerTgg6∂kit edu

Engesserstr. 5

76131 Karlsruhe



Prof. Dr.-Ing. Dr. h. c. Jürgen Becker

Lebenslauf

Studium der Informatik an der Universität Kaiserslautern (Vertiefung Technische Informatik), Abschluss 1992 mit dem Diplom. Von 1992 bis 1997 Wissenschaftlicher Mitarbeiter am Lehrstuhl für Rechnerstrukturen mit Forschungsinteressen in Rechnerarchitekturen (rekonfigurierbare Akzeleratoren), Hardware/Software Codesign und parallelisierenden Compilern, Administrator des europäischen Entwurfsprojekts EUROCHIP an der Universität Kaiserslautern. Abschluss in 1997 mit der Promotion (Dr.-Ing.). Von 1997 bis 2001 Wissenschaftlicher Assistent im Fachbereich Elektrotechnik und Informationstechnik (Lehrstuhl Mikroelektronische Systeme) an der TU Darmstadt. In der Lehre wurden High-Level Synthese und VLSI CAD Algorithmen vertreten, in der industrienahen Forschung Schwerpunkte in dynamisch rekonfigurierbaren Systems-on-Chip und IP-basierten Anwendungsabbildungsverfahren bearbeitet.

2001 Ruf an die Universität Karlsruhe (TH), Institutsleitung des Instituts für Technik der Informationsverarbeitung (ITIV) in der Fakultät für Elektrotechnik und Informationstechnik, Direktor der Gruppe Embedded Systems and Sensors Engineering (ESS) des Forschungszentrum Informatik (FZI) und von 2001 bis 2005 Stellvertretender Direktor (geschäftsführend) des International Department an der Universität Karlsruhe (TH). Landeslehrpreisträger Baden-Württemberg 2003.

Autor und Coautor von mehr als 400 Veröffentlichungen (und mehr als 30 Patenten) mit Schwerpunkt Architekturen und Entwurf von Eingebetteten Elektronischen Systemen mit vielfältigen u.a. industriellen Projekten, insbesondere im Bereich Automotive. Aktiv als Tagungsleiter und in zahlreichen Programmausschüssen internationaler Konferenzen und Workshops. Professor Becker war von Oktober 2005 als Prorektor der Universität Karlsruhe (TH), bzw. von Oktober 2009 bis März 2012 als Chief Higher Education Officer (CHEO) des KIT zuständig für den Bereich Studium und Lehre. Prof. Becker war von 2012 bis 2014 CLUSTER Generalsekretär (Consortium aus 12 Universitäten).
2013 hat Prof. Becker die Ehrendoktorwürde (Dr. h. c.) der Technischen und Wirtschaftswissenschaftlichen Universität (TWU) Budapest erhalten.

 

Forschung

Leitung des Forschungsbereichs „Eingebettete elektronische Systeme“ mit den Forschungsprojekten

  • System-on-Chip (SoC), Network-on-Chip (NoC)
  • Hardware Software Codesign
  • Multi-Core Prozessorarchitekturen
  • Dynamisch Rekonfigurierbare Systeme
    • Hardwarearchitekturen und Akzeleratoren
    • Dynamisch partielle Rekonfigurationstechniken
  • Hardware Synthesemethoden und Multi-Domain Modellierungs- & Simulationsverfahren
  • Cyber-Physical Systems (CPS)

     

    Lehre

     

    Aktivitäten

     

    Konferenzen


    • FPL (International Conference on Field-Programmable Logic and Applications)
    • RAW (Reconfigurable Architecture Workshop)
    • ARC (International Symposium on Applied Reconfigurable Computing)
    • ISVLSI (IEEE Computer Society Annual Symposium on VLSI)
    • IEEE SOCC (IEEE International System-on-Chip Conference)
    • PATMOS (International Workshop on Power And Timing Modeling, Optimization and Simulation)

     

    Projekte

     

    Projekt ARAMiS II

    Zukünftige sicherheitskritische Anwendungen in der Automobil- und Luftfahrt-Industrie, aber auch das Zukunftsthema Industrie 4.0 zeigen einen deutlich steigenden Bedarf an digitaler Rechenleistung.
    Diesem Bedarf entspricht, dass auch die Prozessoren von eingebetteten Systemen in nächster Zeit auf Multicore-Technologie basieren werden, die in anderen Anwendungsgebieten wie PCs, Tablets und Smartphones längst erfolgreich verwendet werden.
    (https://www.itiv.kit.edu/5158.php
     

    Projekt ARAMiS

    ARAMiS (Automotive, Railway and Avionics Multicore Systems) hat zum Ziel, durch den Einsatz von Multicore-Technologie in den Mobilitätsdomänen Automobil, Avionik und Bahn die technologische Basis zur weiteren Erhöhung von Sicherheit, Verkehrseffizienz und Komfort zu schaffen.
    (https://www.itiv.kit.edu/4835.php)

     

    Projekt ARGO

    Verbesserung der Leistung und Reduktion der Kosten, ohne dabei die funktionalen Sicherheit zu beeinflussen, sind die wichtigsten Anforderungen für eingebettete elektronische Systeme zum Beispiel in der Luft- und Raumfahrttechnologie, der Automatisierungstechnik und der Automobilindustrie.
    (https://www.itiv.kit.edu/4833.php)

     

    Projekt InvasIC

    Unter dem Begriff Invasives Rechnen wird ein völlig neues Paradigma für den Entwurf und die Programmierung zukünftiger paralleler Rechensysteme erforscht. Die Grundidee besteht darin, parallelen Programmen die Fähigkeit zu verleihen, in einer als Invasion bezeichneten Phase ressourcengewahr Berechnungen auf eine Menge aktuell verfügbarer Ressourcen zu verteilen, und nach paralleler Abarbeitung diese in einer als Rückzug bezeichneten Phase wieder frei zu geben.
    (https://www.itiv.kit.edu/4837.php)

     

     

    Innovation:

     

     

    emmtrix Technologies GmbH
    Die emmtrix Technologies GmbH ist ein Spin-Off des Instituts für Informationsverarbeitung (ITIV) am Karlsruher Institut für Technologie (KIT). Das Unternehmen entwickelt Softwarewerkzeuge, welche die Programmierung von Mehrkernprozessoren in eingebetteten Systemen (z.B. Fahrassistenzsysteme) signifikant vereinfacht und optimiert.
    (www.emmtrix.com)

     

     

     

    

    19 Veröffentlichungen im Jahr 2005


    18 Journals & Bücher
    • G. J. M. Smit, E. Schuler, J. Becker, J. Quevremont, W. Brugger
      Overview of the 4S Project
      In System-on-Chip, 2005. Proceedings. 2005 International Symposium on, S. 70-73, 2005

    • C. Bieser, K. D. Mueller-Glaser, J. Becker
      From VHDL Bit-Level Coding up to CASE-Tool Based System Modeling.
      In Microelectronic Systems Education, 2005. (MSE ‘05). Proceedings. 2005 IEEE International Conference June 2005, S. Pages: 51-52, 2005

    • M. Huebner, K. Paulsson, J. Becker
      Parallel and Flexible Multiprocessor System-On-Chip for Adaptive Automotive Applications based on Xilinx MicroBlaze Soft-Cores
      In Parallel and Distributed Processing Symposium, 2005. Proceedings. 19th IEEE International, S. 149a-149a, 2005

    • J. Becker, A. Thomas
      Scalable processor instruction set extension
      In Design & Test of Computers, IEEE, Band 22, S. 136-148, 2005

    • M. Ullmann, J. Becker, K. Braendle
      Rekonfigurierbare Hardware und intelligente Laufzeitsysteme für adaptives Rechnen.
      In IT Information technology . vol. 4, S. pp. S. 201–206, 2005

    • K. Paulsson, M. Huebner, H. Zou, J. Becker
      Realization of Real-Time Control Flow Oriented Automotive Applications on a Soft-core Multiprocessor System based on Xilinx Virtex II FPGAs.
      In ARC05 Portugal, 2005

    • M. Huebner, K. Paulsson, M. Stitz, J. Becker
      Novel Seamless Design-Flow for Partial and Dynamic Reconfigurable Systems with Customized Communication Structures Based on Xilinx Virtex-II FPGAs.
      In ARCS05 Innsbruck, Austria, 2005

    • A. Donlin, M. Huebner, J. Becker
      Models and Tools for the Dynamic Reconfiguration of FPGAs.
      In IEEE-SOCC2005 Washington, USA, 2005

    • M. Ullmann, W. Jin, J. Becker
      Hardware Enhanced Function Allocation Management in Reconfigurable Systems.
      In Submitted and accepted for 12th Reconfigurable Architectures Workshop (RAW/IPDPS) 2005, 2005

    • C. Morra, J. Becker, M. Ayala-Rincon, R. Hartenstein
      FELIX: Using Rewriting-Logic for Generating Functionally Equivalent Implementations
      In Proceedings 15th International Conference on Field Programmable Logic and Applications Tampere, Finnland, 2005

    • M. Huebner, J. Becker, K. Paulsson, A. Thomas
      Dynamic Reconfiguration On-Demand: Real-time Adaptivity in Next Generation Microelectronics.
      In ReCoSoc2005 Montpellier, France, 2005

    • J. Becker, M. Huebner, K. D. Mueller-Glaser, R. Constapel, J. Luka, J. Eisenmann
      Automotive Control Unit Optimisation Perspectives: Body Functions on-Demand by Dynamic Reconfiguration.
      In Date2005 Munich, Germany, 2005

    • M. Ullmann, W. Jin, J. Becker
      Hardware Support for QoS-based Function Allocation in Reconfigurable Systems
      In Proceedings of 8th conference for design, automation and test DATE 2005, Munich, Germany, March 2005, S. pp. 259-264, 2005

    • M. Huebner, M. Ullmann, J. Becker
      Real-time configuration code decompression for dynamic FPGA self reconfiguration: evaluation and implementation
      In International Journal Embedded Systems, Vol. 1, No. 3/4, 2005, pp. 263 - 273, Band Vol. 1, S. pp. 263 - 273, 2005

    • A. Thomas, J. Becker
      Multi-grained Reconfigurable Datapath Structures for Online-Adaptive Reconfigurable Hardware Architectures
      In IEEE Computer Society Annual Symposium on VLSI (ISVLSI 2005), Tampa, Florida, May 11-12, 2005, 2005

    • A. Thomas, J. Becker
      Online-adaptive Reconfigurable Hardware Architecture and Runtime Environment
      In IEEE International SOC Conference (SOCC2005), Dulles Airport, Washington, September 25-28, 2005, 2005

    • A. Thomas, J. Becker
      Multi-grained Reconfigurable Harware Architecture with Online-Adaptive Routing Techniques
      In IFIP International Conference on Very Large Scale Integration (IFIP VLSI-SOC 2005), Perth, Western Australia, October 17-19, 2005, 2005

    • M. Boden, S. Ruelke, J. Becker
      Design Of Optimized Reconfigurable HW Tasks Using Operation Graph Signatures
      In 8th Euromicro Conference on Digital System Design (DSD), Porto, Portugal, Aug/Sep 2005, 2005

    1 Konferenz- & Workshop-Beiträge
    • P. T. Wolkotte, G. J. M. Smit, N. Kavaldjiev, J. E. Becker, J. Becker
      Energy Model of Networks-on-Chip and a Bus
      In International Symposium on System-on-Chip, 2005. Proceedings., S. 82-85, 2005

    Veröffentlichungen nach Jahren auflisten
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