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Becker

Prof. Dr.-Ing. Dr. h. c. Jürgen Becker

Institutsleiter (Sprecher)
Raum: 324
Tel.: +49 721 608-42502
Fax: +49 721 608-42925
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Engesserstr. 5

76131 Karlsruhe



Prof. Dr.-Ing. Dr. h. c. Jürgen Becker

Lebenslauf

Studium der Informatik an der Universität Kaiserslautern (Vertiefung Technische Informatik), Abschluss 1992 mit dem Diplom. Von 1992 bis 1997 Wissenschaftlicher Mitarbeiter am Lehrstuhl für Rechnerstrukturen mit Forschungsinteressen in Rechnerarchitekturen (rekonfigurierbare Akzeleratoren), Hardware/Software Codesign und parallelisierenden Compilern, Administrator des europäischen Entwurfsprojekts EUROCHIP an der Universität Kaiserslautern. Abschluss in 1997 mit der Promotion (Dr.-Ing.). Von 1997 bis 2001 Wissenschaftlicher Assistent im Fachbereich Elektrotechnik und Informationstechnik (Lehrstuhl Mikroelektronische Systeme) an der TU Darmstadt. In der Lehre wurden High-Level Synthese und VLSI CAD Algorithmen vertreten, in der industrienahen Forschung Schwerpunkte in dynamisch rekonfigurierbaren Systems-on-Chip und IP-basierten Anwendungsabbildungsverfahren bearbeitet.

2001 Ruf an die Universität Karlsruhe (TH), Institutsleitung des Instituts für Technik der Informationsverarbeitung (ITIV) in der Fakultät für Elektrotechnik und Informationstechnik, Direktor der Gruppe Embedded Systems and Sensors Engineering (ESS) des Forschungszentrum Informatik (FZI) und von 2001 bis 2005 Stellvertretender Direktor (geschäftsführend) des International Department an der Universität Karlsruhe (TH). Landeslehrpreisträger Baden-Württemberg 2003.

Autor und Coautor von mehr als 400 Veröffentlichungen (und mehr als 30 Patenten) mit Schwerpunkt Architekturen und Entwurf von Eingebetteten Elektronischen Systemen mit vielfältigen u.a. industriellen Projekten, insbesondere im Bereich Automotive. Aktiv als Tagungsleiter und in zahlreichen Programmausschüssen internationaler Konferenzen und Workshops. Professor Becker war von Oktober 2005 als Prorektor der Universität Karlsruhe (TH), bzw. von Oktober 2009 bis März 2012 als Chief Higher Education Officer (CHEO) des KIT zuständig für den Bereich Studium und Lehre. Prof. Becker war von 2012 bis 2014 CLUSTER Generalsekretär (Consortium aus 12 Universitäten).
2013 hat Prof. Becker die Ehrendoktorwürde (Dr. h. c.) der Technischen und Wirtschaftswissenschaftlichen Universität (TWU) Budapest erhalten.

 

Forschung

Leitung des Forschungsbereichs „Eingebettete elektronische Systeme“ mit den Forschungsprojekten

  • System-on-Chip (SoC), Network-on-Chip (NoC)
  • Hardware Software Codesign
  • Multi-Core Prozessorarchitekturen
  • Dynamisch Rekonfigurierbare Systeme
    • Hardwarearchitekturen und Akzeleratoren
    • Dynamisch partielle Rekonfigurationstechniken
  • Hardware Synthesemethoden und Multi-Domain Modellierungs- & Simulationsverfahren
  • Cyber-Physical Systems (CPS)

     

    Lehre

     

    Aktivitäten

     

    Konferenzen


    • FPL (International Conference on Field-Programmable Logic and Applications)
    • RAW (Reconfigurable Architecture Workshop)
    • ARC (International Symposium on Applied Reconfigurable Computing)
    • ISVLSI (IEEE Computer Society Annual Symposium on VLSI)
    • IEEE SOCC (IEEE International System-on-Chip Conference)
    • PATMOS (International Workshop on Power And Timing Modeling, Optimization and Simulation)

     

    Projekte

     

    Projekt ARAMiS II

    Zukünftige sicherheitskritische Anwendungen in der Automobil- und Luftfahrt-Industrie, aber auch das Zukunftsthema Industrie 4.0 zeigen einen deutlich steigenden Bedarf an digitaler Rechenleistung.
    Diesem Bedarf entspricht, dass auch die Prozessoren von eingebetteten Systemen in nächster Zeit auf Multicore-Technologie basieren werden, die in anderen Anwendungsgebieten wie PCs, Tablets und Smartphones längst erfolgreich verwendet werden.
    (https://www.itiv.kit.edu/5158.php
     

    Projekt ARAMiS

    ARAMiS (Automotive, Railway and Avionics Multicore Systems) hat zum Ziel, durch den Einsatz von Multicore-Technologie in den Mobilitätsdomänen Automobil, Avionik und Bahn die technologische Basis zur weiteren Erhöhung von Sicherheit, Verkehrseffizienz und Komfort zu schaffen.
    (https://www.itiv.kit.edu/4835.php)

     

    Projekt ARGO

    Verbesserung der Leistung und Reduktion der Kosten, ohne dabei die funktionalen Sicherheit zu beeinflussen, sind die wichtigsten Anforderungen für eingebettete elektronische Systeme zum Beispiel in der Luft- und Raumfahrttechnologie, der Automatisierungstechnik und der Automobilindustrie.
    (https://www.itiv.kit.edu/4833.php)

     

    Projekt InvasIC

    Unter dem Begriff Invasives Rechnen wird ein völlig neues Paradigma für den Entwurf und die Programmierung zukünftiger paralleler Rechensysteme erforscht. Die Grundidee besteht darin, parallelen Programmen die Fähigkeit zu verleihen, in einer als Invasion bezeichneten Phase ressourcengewahr Berechnungen auf eine Menge aktuell verfügbarer Ressourcen zu verteilen, und nach paralleler Abarbeitung diese in einer als Rückzug bezeichneten Phase wieder frei zu geben.
    (https://www.itiv.kit.edu/4837.php)

     

     

    Innovation:

     

     

    emmtrix Technologies GmbH
    Die emmtrix Technologies GmbH ist ein Spin-Off des Instituts für Informationsverarbeitung (ITIV) am Karlsruher Institut für Technologie (KIT). Das Unternehmen entwickelt Softwarewerkzeuge, welche die Programmierung von Mehrkernprozessoren in eingebetteten Systemen (z.B. Fahrassistenzsysteme) signifikant vereinfacht und optimiert.
    (www.emmtrix.com)

     

     

     

    

    15 Veröffentlichungen im Jahr 2004


    13 Journals & Bücher
    • J. Becker, S. Vernalde, M. Platzner
      Int´l. Conference on Field-Programmable Logic and Applications
      In FPL04 Antwerpen, Belgien, 2004

    • M. Huebner, M. Ullmann, L. Braun, A. Klausmann, J. Becker
      Scalable Application-Dependent Network on Chip Adaptivity for Dynamical Reconfigurable Real-Time Systems
      In Lecture Notes in Computer Science, S. 1037-1041, 2004

    • U. Brinkschulte, J. Becker, D. Fey, K. Grosspietsch, C. Hochberger, E. Maehle, T. Runkler
      GI Lecture Notes in Informatics
      In Proceedings of Organic and Pervasive Computing Workshops, in conjunction with 17th Int´l. Conf. on Architecture of Computing Systems (ARCS 2004) Augsburg, Germany, 2004

    • M. Huebner, M. Ullmann, F. Weissel, J. Becker
      Real-time Configuration Code Decompression for Dynamic FPGA Self-Reconfiguration
      In Kongressbericht: DATE 04, Design, Automation and Test in Europe Paris, 2004

    • M. Huebner, T. Becker, J. Becker
      Real-time LUT-based Network Topologies for dynamic and partial FPGA Self-Reconfiguration
      In SBCCI04, Porto de Galinhas, Brasil, 2004

    • M. Ullmann, M. Huebner, B. Grimm, J. Becker
      On-Demand FPGA Run-Time System for Dynamical Reconfiguration with Adaptive Priorities
      In FPL04, Antwerpen, 2004

    • M. Huebner, M. Ullmann, F. Weissel, J. Becker
      Real-time Configuration Code Decompression for Dynamic FPGA Self-Reconfiguration
      In RAW04, 2004

    • M. Ullmann, B. Grimm, M. Huebner, J. Becker
      An FPGA Run-Time System for Dynamical On-Demand Reconfiguration
      In RAW 04, 2004

    • A. Thomas, J. Becker
      Dynamic Adaptive Routing Techniques In Multigrain Dynamic Reconfigurable Hardware Architectures
      In 14th Int´l. Conference on Field-Programmable Logic and Applications (FPL 2004), Lecture Notes in Computer Science 3203 Springer 2004, pp. 115 - 124, ISBN 3-540-22989-2, S. pp. 115 - 124, 2004

    • A. Thomas, J. Becker, U. Heinkel, K. Winkelmann, J. Bormann
      Formale Verifikation eines Sonet/SDH Framers
      In Tagungsband "Methoden und Beschreibungssprachen zur Modellierung und Verifikation von Schaltungen und Systemen", GI/ITG/GMM Workshop, Kaiserslautern, Februar 24-25, 2004, 2004

    • A. Thomas, J. Becker
      Aufbau- und Strukturkonzepte einer adaptiven multigranularen rekonfigurierbaren Hardwarearchitektur
      In 17th International Conference on Architecture of Computing Systems (ARCS 2004)", Workshop "Dynamically Reconfigurable Systems", Augsburg, März 23-26, 2004, 2004

    • A. Thomas, J. Becker, U. Heinkel, K. Winkelmann, J. Bormann
      Formale Verifikation eines Sonet/SDH Framers
      In Tagungsband "Dresdner Arbeitstagung Schaltungs- und Systementwurf (DASS´2004) und IP2 Workshop", Dresden, April 19-20, 2004, 2004

    • A. Thomas, T. Zander, J. Becker
      Adaptive DMA-based I/O Interfaces for Data Stream Handling in Multi-grained Reconfigurable Hardware Architectures
      In Symposium on Integrated Circuits and Systems Design (SBCCI 2004), Porto de Galinhas, Pernambuco, Brazil, September 7-11, 2004, 2004

    2 Konferenz- & Workshop-Beiträge
    • A. Thomas, J. E. Becker, J. Becker
      Anwendungsspezifische IP-Generierung für zukünftige SoC-Implementierungen in mobilen Kommunikationssystemen
      In Dresdner Arbeitstagung Schaltungs- und Systementwurf (DASS´2004), 2004

    • U. Brinkschulte, J. Becker, H. Dorfmueller-Ulhaas, R. Koenig, S. Uhrig, T. Ungerer
      CARUSO – Project Goals and Principal Approach
      In , 2004

    Veröffentlichungen nach Jahren auflisten
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